Allegro Global Route Environment

Si les réseaux de signal ont été combinés en paquets (bundles) en groupes fonctionnels dans Allegro PCB Designer, ces bundles peuvent être utilisés pour des planifications ultérieures du routage. Avec Allegro PCB Design Planning Option deux autres pas de planifications se laissent effectuer: "Plan Spatial" et "Plan Topological". Dans le "Global Route Environment" (GRE) il est aussi possible avec l'étape finale de faire  le "Delay Tuning" et la conversion en cuivre. Comme toutes les étapes prévues restent en tant que chevelus intelligents dans les données de conception, les étapes de planification en avant et en arrière sont possibles. Et le résultat total peut être amélioré itérativement. Avec Delay Tuning différents paramètres peuvent être spécifiés afin que le résultat soit aussi proche que possible à un résultat du routage manuel.  


Points forts 

  • Route around Etch Shapes
  • Disable Compression During Plan Accurate
  • Allow or Prohibit Tuning in Constraint Regions
  • Embedded Component Support
  • Performance and Quality Improvements


Allegro Global Route Environment GUI
Dans la surface GRE ont peut définir des paramètres si: 
  • (1) il faut faire le routage autour les surfaces de cuivre          
  • (2) un Delay dans Constraint Regions est permis                    
  • (3) la compression est déclanchée pendant Plan Accurate   




 
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